醍狭郊利

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HYPERFLASH?

HYPERBUS?インタ`フェ`スを笋┐娠薫晋薀侫薀奪轡

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古勣

HYPERFLASH? 鰻或檎フラッシュ メモリは、d枠M\屶址システム (ADAS)、インストルメントクラスタ`、インフォテインメントシステム、ファクトリ`オ`トメ`ション、ネットワ`クル`タ`やスイッチのMみzみシステムに駅勣な來嬬を戻工します。 パラレル鰻或檎フラッシュの3蛍の1のピン方で333MB/昼のiみ函り。囃嫌を戻工します。

麼な字嬬

  • 166 MHz のDDR (333 MB/s)
  • x8 インタ`フェ`ス
  • ディ`プ パワ`ダウン(8μA)
  • 概墮喘粥掘遺-河100範協gみ
  • -40 <C ゛+125 <C
  • ECC (`り屎コ`ド)
  • 京赫粥パッケ`ジ
  • 20定寂のデ`タ隠隔
  • 恷寄100一サイクルの塚消來

ファミリ`の曳熟

u瞳

古勣

NOR フラッシュに隠贋されたブ`トコ`ドをシステムマイクロコントロ`ラ`に儻堀に塘佚することで、鵬rに羨ち貧げることができます。 NOR フラッシュに隠贋された並念レンダリング鮫颪鬟哀薀侫ックス マイクロコントロ`ラ`に塘佚することにより、互盾餠肇妊スプレイをサポ`トします。 デジタルインストルメントクラスタ`のタコメ`タ`など、}方の鮫颪鮓瀚戮播簧鼎垢襪海箸如}jな咾やグラフィックスを燕幣します。

麼な字嬬

  • 互來嬬 : 166 MHz DDR (333 MB/s) で嘛する x8 インタ`フェ`ス
  • ピン方が富ない:12ピン インタ`フェ`スによりBOM コストをp (パラレルNORと曳^)
  • 詰M薦モ`ド : ディ`プパワ`ダウン (8μA) をサポ`ト
  • d喘AEC-Q100グレ`ド1 (-40 ≧゛125 ≧)。

インフィニオン鏡徭のMIRRORBIT?テクノロジ`は、弊順で恷も枠M議な鰻或檎フラッシュプロセス室gであり、互畜業デバイスに恷mです。 セルあたり2ビットを鯉{し、インフィニオンの嫌レいパラレルおよびシリアル鰻或檎フラッシュu瞳の児Pとなっています。

インフィニオンのフラッシュメモリu瞳海豚工公プログラムは、インフィニオンの恷も繁櫃里△襯瓮皀袞u瞳の辛喘來をし、L勉凋のプラットフォ`ムに鬉靴泙后5簧裕弔癖拊は、伏bリリ`ス晩から10定參貧です。プログラムの鵑箸覆覬薫晋薀侫薀奪轡縣u瞳をxkすることで、芦伉湖と嶷勣なメモリデバイスの埓里淵汽廛薀ぅ船З`ンの寓{を鞭けることができます。

インフィニオンは、弊順嶄のチップセットパ`トナ`とf薦して、パ`トナ`のSoCでメモリをJ協し、ドライバ`とソフトウェアを編^し、タ`ンキ`リファレンスデザインを_kしています。そのY惚、Oプロセスを殆晒し、偏誘秘までのrgを玉sする匯Bのツ`ルとリソ`スが誼られます。 チップセットに容XおよびJ協されたメモリをxkできるように、インフィニオンはチップセットペアリングガイドをk佩しています。 これらのスプレッドシ`トは、どのインフィニオンメモリu瞳がどのパ`トナ`チップセットでJ協されているかをマッピングします。

NOR フラッシュに隠贋されたブ`トコ`ドをシステムマイクロコントロ`ラ`に儻堀に塘佚することで、鵬rに羨ち貧げることができます。 NOR フラッシュに隠贋された並念レンダリング鮫颪鬟哀薀侫ックス マイクロコントロ`ラ`に塘佚することにより、互盾餠肇妊スプレイをサポ`トします。 デジタルインストルメントクラスタ`のタコメ`タ`など、}方の鮫颪鮓瀚戮播簧鼎垢襪海箸如}jな咾やグラフィックスを燕幣します。

麼な字嬬

  • 互來嬬 : 166 MHz DDR (333 MB/s) で嘛する x8 インタ`フェ`ス
  • ピン方が富ない:12ピン インタ`フェ`スによりBOM コストをp (パラレルNORと曳^)
  • 詰M薦モ`ド : ディ`プパワ`ダウン (8μA) をサポ`ト
  • d喘AEC-Q100グレ`ド1 (-40 ≧゛125 ≧)。

インフィニオン鏡徭のMIRRORBIT?テクノロジ`は、弊順で恷も枠M議な鰻或檎フラッシュプロセス室gであり、互畜業デバイスに恷mです。 セルあたり2ビットを鯉{し、インフィニオンの嫌レいパラレルおよびシリアル鰻或檎フラッシュu瞳の児Pとなっています。

インフィニオンのフラッシュメモリu瞳海豚工公プログラムは、インフィニオンの恷も繁櫃里△襯瓮皀袞u瞳の辛喘來をし、L勉凋のプラットフォ`ムに鬉靴泙后5簧裕弔癖拊は、伏bリリ`ス晩から10定參貧です。プログラムの鵑箸覆覬薫晋薀侫薀奪轡縣u瞳をxkすることで、芦伉湖と嶷勣なメモリデバイスの埓里淵汽廛薀ぅ船З`ンの寓{を鞭けることができます。

インフィニオンは、弊順嶄のチップセットパ`トナ`とf薦して、パ`トナ`のSoCでメモリをJ協し、ドライバ`とソフトウェアを編^し、タ`ンキ`リファレンスデザインを_kしています。そのY惚、Oプロセスを殆晒し、偏誘秘までのrgを玉sする匯Bのツ`ルとリソ`スが誼られます。 チップセットに容XおよびJ協されたメモリをxkできるように、インフィニオンはチップセットペアリングガイドをk佩しています。 これらのスプレッドシ`トは、どのインフィニオンメモリu瞳がどのパ`トナ`チップセットでJ協されているかをマッピングします。

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