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EZ-PD? PAG1P 1次側コントローラー

二次侧制御の一次起动コントローラー

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概要

EZ-PD? PAG1Pは、2次側制御フライバックコンバーターのEZ-PD? PAG1Sで動作するように設計された1次側スタートアップコントローラーです。 EZ-PD? PAG1Pは、HVスタートアップ機能、PETレシーバー、ローサイドNFETゲートドライバ、ハイサイド論理レベルドライバ、およびフォルト保護 (ラインUVP/OVP、OCP、セカンダリVBUSスタートアップOVP) を提供します。 Xキャップ放電モードと非Xキャップ放電モードの両方をサポートしています。

主な机能

  • 统合型高电圧スタートアップ
  • 统合型ローサイド?ゲート?ドライバ
  • Line UVPおよびOVP
  • サポート?プライマリ翱颁笔
  • スタートアップ?セカンダリVBUS OVP
  • プログラマブル?ソフトスタート
  • 统合型笔贰罢レシーバー

製品

概要

高电圧スタートアップとソフトスタートの详细

ライン電圧が通常の動作範囲内になると、ゲートドライバはスイッチングを開始します。 内蔵の高電圧JFETは、HVピンから電流を取り、起動段階でVCCコンデンサを充電します。 フライバックトランスからの補助巻線は、起動フェーズ後にEZ-PD? PAG1Pを供給するために使用され、スタートアップフェーズ後にHVピンから電流は供給されません。 ソフトスタート機能により、EZ-PD? PAG1Pは、2次側がレギュレーションを制御するまで、フライバックコンバーターの出力電圧を徐々に増加させることができます。 ソフトスタートは、初期起動シーケンスおよび障害状態で使用されます。 ソフトスタート時間はSSピンに接続された外付けコンデンサによって制御され、ソフトスタートの周波数はRTピンに接続された外付け抵抗によって決定されます。 5μAの内部電流源が外付けコンデンサーを充電し、ソフトスタートランプの最大振幅は3.75 Vで、3.75 Vが最大デューティサイクルを決定します。 ソフトスタートでは、１次側FETの最大オン時間は19μsに制限され、これは30kHzでの70%デューティサイクルに相当します。 2次側が制御を引き継ぐとき、最大オン時間は25μsに制限されます。

齿キャップモードと非齿キャップモードの详细

EZ-PD? PAG1P では、64 ミリ秒以内に 3 つのV_VDD700UVRISE遷移が発生すると、X-cap モードが検出されます。 デバイスがX-capモードで動作していることを示すフラグが設定されます。 フラグ設定後64ms以内に3回のV_VDD700UVRISE遷移が検出されない場合、ライン切断を検出し、内部放電経路をONにしてXキャパシタを放電します。 非Xキャップ放電モードでは、HVピンはDC整流電圧に接続されます。 このピンは、起動時にEZ-PD? PAG1Pに電力を供給します。 さらに、HVピンを介して低電圧および過電圧保護を提供します。 障害が存在する限り、保護は有効になります。

セカンダリ同期の详细

スタートアップフェーズで、EZ-PD? PAG1P が PULSEIN ピンで適切な入力パルスを検出すると、プライマリ FET 制御を２次側パルスに同期させます。 2次側からのPWM制御信号は、パルスエッジトランス(CYPET131)を使用して1次側に結合されます。 PETは適切な周波数応答を確保するための重要なコンポーネントであり、過度のオーバーシュートを回避するために適切なQファクターを備えている必要があります。 PETからの正のパルスは１次側FETのターンオン信号として扱われ、PETからの負のパルスは１次側FETのターンオフ信号として扱われます。 パルス振幅はV_PULSEINNEGAMPおよびV_PULSEINPOSAMPを超えてはならず、パルス幅はT_PULSEINPW範囲内でなければなりません。 PETを介した２次側と１次側間の同期パスは、シャットダウン状態の通信にも使用されます。 2次側からの3つの連続した負のパルスは、シャットダウン信号として扱われます。 3つの連続した負のパルスを受信すると、EZ-PD? PAG1Pは200ミリ秒後にシャットダウンします。

高电圧スタートアップとソフトスタートの详细

ライン電圧が通常の動作範囲内になると、ゲートドライバはスイッチングを開始します。 内蔵の高電圧JFETは、HVピンから電流を取り、起動段階でVCCコンデンサを充電します。 フライバックトランスからの補助巻線は、起動フェーズ後にEZ-PD? PAG1Pを供給するために使用され、スタートアップフェーズ後にHVピンから電流は供給されません。 ソフトスタート機能により、EZ-PD? PAG1Pは、2次側がレギュレーションを制御するまで、フライバックコンバーターの出力電圧を徐々に増加させることができます。 ソフトスタートは、初期起動シーケンスおよび障害状態で使用されます。 ソフトスタート時間はSSピンに接続された外付けコンデンサによって制御され、ソフトスタートの周波数はRTピンに接続された外付け抵抗によって決定されます。 5μAの内部電流源が外付けコンデンサーを充電し、ソフトスタートランプの最大振幅は3.75 Vで、3.75 Vが最大デューティサイクルを決定します。 ソフトスタートでは、１次側FETの最大オン時間は19μsに制限され、これは30kHzでの70%デューティサイクルに相当します。 2次側が制御を引き継ぐとき、最大オン時間は25μsに制限されます。

齿キャップモードと非齿キャップモードの详细

EZ-PD? PAG1P では、64 ミリ秒以内に 3 つのV_VDD700UVRISE遷移が発生すると、X-cap モードが検出されます。 デバイスがX-capモードで動作していることを示すフラグが設定されます。 フラグ設定後64ms以内に3回のV_VDD700UVRISE遷移が検出されない場合、ライン切断を検出し、内部放電経路をONにしてXキャパシタを放電します。 非Xキャップ放電モードでは、HVピンはDC整流電圧に接続されます。 このピンは、起動時にEZ-PD? PAG1Pに電力を供給します。 さらに、HVピンを介して低電圧および過電圧保護を提供します。 障害が存在する限り、保護は有効になります。

セカンダリ同期の详细

スタートアップフェーズで、EZ-PD? PAG1P が PULSEIN ピンで適切な入力パルスを検出すると、プライマリ FET 制御を２次側パルスに同期させます。 2次側からのPWM制御信号は、パルスエッジトランス(CYPET131)を使用して1次側に結合されます。 PETは適切な周波数応答を確保するための重要なコンポーネントであり、過度のオーバーシュートを回避するために適切なQファクターを備えている必要があります。 PETからの正のパルスは１次側FETのターンオン信号として扱われ、PETからの負のパルスは１次側FETのターンオフ信号として扱われます。 パルス振幅はV_PULSEINNEGAMPおよびV_PULSEINPOSAMPを超えてはならず、パルス幅はT_PULSEINPW範囲内でなければなりません。 PETを介した２次側と１次側間の同期パスは、シャットダウン状態の通信にも使用されます。 2次側からの3つの連続した負のパルスは、シャットダウン信号として扱われます。 3つの連続した負のパルスを受信すると、EZ-PD? PAG1Pは200ミリ秒後にシャットダウンします。

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